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起止时间:2020-02-24到2020-07-10
更新状态:已完结
第四章 数字集成电路 第四章单元测验
1、 下列说法不正确的是（ ）
A:普通门的输出端不能直接连在一起
B:三态门输出端有可能出现三种状态（高阻态、高电平、低电平）
C:三态门输出端直接连接可以实现正逻辑的线或运算
D:利用三态门电路可实现双向传输
答案: 三态门输出端直接连接可以实现正逻辑的线或运算
2、 以下错误的是（ ）
A:译码器可分为二进制和非二进制译码器
B:实现两个一位二进制数相加的电路叫全加器
C:实现两个一位二进制数和来自低位的进位相加的电路叫全加器
D:BCD码是用二进制数编码来表示十进制数
答案: 实现两个一位二进制数相加的电路叫全加器
3、 组合逻辑电路通常由（ ）组合而成。
A:门电路
B:触发器
C:计数器
D:寄存器
答案: 门电路
4、 十六路数据选择器的地址输入（选择控制）端有（ ）个。
A:16
B:2
C:4
D:8
答案: 4
5、 一个8421BCD码译码器的数据输入线与译码输出线的组合是（ ）。
A:4:6
B:1:10
C:4:10
D:2:4
答案: 4:10
6、 有一个左移移位寄存器，当预先置入1011后，其串行输入固定接0，在4个移位脉冲CP作用下，四位数据的移位过程是（ ）。
A:1011–0110–1100–1000—0000
B:1011–0101–0010–0001—0000
C:1011–0000–1100–0110—1000
D: 0001–0101–0010–0000—1011
答案: 1011–0110–1100–1000—0000
7、 16个触发器构成计数器，该计数器可能的最大计数数值是（ ）
A:16
B:32
C:
D:
答案:
8、 在函数F=AB+CD的真值表中，F=1的状态有多少个？（ ）。
A:2
B:4
C:6
D:7
答案: 7
9、 电路的输出态不仅与当前输入信号有关，还与前一时刻的电路状态有关，这种电路为（ ）。
A:组合电路
B:时序电路
C:加法电路
D:译码电路
答案: 时序电路
10、 在下列逻辑电路中，不是组合逻辑电路的有（ ）。
A:译码器
B:编码器
C:全加器
D:寄存器
答案: 寄存器
11、 把一个五进制计数器与一个四进制计数器串联可得到 （ ）进制计数器。
A:4
B:5
C:9
D:20
答案: 20
12、 N个触发器可以构成最大计数长度（进制数）为（ ）的计数器。
A:N
B:2N
C:
D:
答案:
13、 同步时序电路和异步时序电路比较，其差异在于后者（ ） 。
A:没有触发器
B:没有统一的时钟脉冲控制
C:没有稳定状态
D:输出只与内部状态有关
答案: 没有统一的时钟脉冲控制
14、 指出下列电路中能把串行数据转换为并行数据的是（ ）
A:JK触发器
B:3线-8线译码器
C:移位寄存器
D:十进制计数器
答案: 移位寄存器
15、 TTL或非门多余输入端可以接高电平。
A:正确
B:错误
答案: 错误
16、 寄存器属于组合逻辑电路。
A:正确
B:错误
答案: 错误
17、 构成一个5进制计数器需要5个触发器。
A:正确
B:错误
答案: 错误
18、 当时序逻辑电路存在有效循环时该电路能自启动。
A:正确
B:错误
答案: 错误
19、 八路数据分配器的地址输入（选择控制）端有8个。
A:正确
B:错误
答案: 错误
20、 关门电平UOFF是允许的最小输入高电平。
A:正确
B:错误
答案: 错误
21、 三态门输出为高阻时，其输出线上电压为高电平。
A:正确
B:错误
答案: 错误
22、 五进制计数器的有效状态为五个。
A:正确
B:错误
答案: 正确
23、 当时序逻辑电路存在无效循环时该电路不能自启动。
A:正确
B:错误
答案: 正确
24、 RS触发器、JK触发器的输出均有不定状态。
A:正确
B:错误
答案: 错误
25、 构成一个7进制计数器至少需要3个触发器。
A:正确
B:错误
答案: 正确
26、 两个二进制数相加，并加上来自低位的进位，称为全加，所用的电路为全加器。
A:正确
B:错误
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